CMOS 인버터: PMOS와 NMOS가 만나는 순간

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CMOS 인버터: PMOS와 NMOS가 만나는 순간

안녕하세요? 반도체 마스터입니다.

스마트폰 속 수십억 개의 트랜지스터는 단순한 회로들의 조합입니다. 그 가장 작은 단위가 바로 CMOS 인버터예요. 오늘은 NMOS와 PMOS가 '0을 1로, 1을 0으로' 바꾸는 원리와, 이 구조가 현대 칩의 표준이 된 이유를 정리해봅니다.

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CMOS의 구조: 상보적 한 쌍

CMOS는 NMOS와 PMOS를 위아래로 직렬 연결한 구조입니다. PMOS는 위쪽(VDD), NMOS는 아래쪽(GND)에 있고, 두 게이트는 입력에, 두 드레인은 출력에 함께 묶입니다. 입력이 '1'이면 NMOS만 켜져 출력 '0', 입력이 '0'이면 PMOS만 켜져 출력 '1'이 됩니다.

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왜 전력 소모가 거의 없을까

CMOS의 가장 큰 장점은 정지 상태에서 전력을 거의 먹지 않는다는 점입니다. 출력 상태와 무관하게 두 트랜지스터 중 하나는 반드시 꺼져 있어 VDD에서 GND로 흐르는 직접 경로가 없죠. 전류가 흐르는 건 입력이 바뀌며 두 트랜지스터가 잠깐 동시에 켜지는 스위칭 순간뿐입니다. '동작할 때만 전기를 쓴다'는 이 특성이 모바일 기기에 최적화된 이유입니다.

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왜 PMOS가 위쪽, NMOS가 아래쪽일까

배치에도 이유가 있습니다. 전자(electron)의 이동도는 정공(hole)의 2~3배라 같은 크기의 NMOS가 PMOS보다 전류를 더 잘 흘립니다. 그래서 NMOS를 풀다운에 두면 '0' 출력이 단단해지고, PMOS를 풀업에 두면 '1' 출력이 VDD까지 완전히 올라갑니다. 반대로 두면 출력이 문턱전압(Vth)만큼 뜨게 되어 완전한 LOW/HIGH가 나오지 않죠.

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VTC 곡선과 잡음 여유도

인버터의 품질을 평가하는 대표 도구는 VTC(Voltage Transfer Characteristic) 곡선입니다. 입력을 0부터 VDD까지 올리며 출력을 그린 곡선으로, 전이 구간이 가파를수록 좋은 인버터입니다. 여기서 잡음 여유도(noise margin)가 나옵니다. NM_L·NM_H가 클수록 입력에 노이즈가 섞여도 출력이 흔들리지 않으니, 칩이 실제 환경에서 안정적으로 동작하는 기준이 됩니다.

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NMOS만 쓰던 시절과 비교하면

CMOS 이전에는 NMOS만으로 로직을 만들던 시절이 있었습니다. 부하를 항상 켜진 트랜지스터로 두는 방식이라 출력 '1'일 때 전류가 계속 흘러 정적 전력이 컸죠. CMOS 도입으로 '대기 전력이 거의 없는' 시대가 열렸고, 면접 정석 답은 'NMOS 로직을 대체한 가장 큰 이유 = 낮은 정적 전력 소모'입니다.

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면접 답변 포인트

• '동작 설명': 입력 HIGH → NMOS ON·PMOS OFF → 출력 LOW, 입력 LOW → 반대. 회로 흐름대로 설명
• '왜 전력이 적은가': 정지 상태에서는 하나가 항상 OFF라 직접 경로가 없고, 스위칭 순간에만 전류가 흐름
• 'PMOS가 위쪽인 이유': 전자 이동도가 높은 NMOS가 풀다운, PMOS를 풀업에 두어야 출력 HIGH가 VDD까지 완전히 올라감
• '잡음 여유도란': 입력 노이즈에도 출력이 흔들리지 않는 허용 범위로, VTC 곡선에서 읽는 NM_L·NM_H

오늘은 디지털 칩의 가장 작은 벽돌인 CMOS 인버터를 정리해봤습니다. 회로도·단면도·VTC 곡선을 함께 보면서 '왜 이렇게 배치했을까'를 계속 물어보면 소자 문제가 훨씬 쉬워집니다!

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