선택적 에피택시 성장: 소스·드레인에 실리콘 결정을 키워 올리는 기술

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선택적 에피택시 성장: 소스·드레인에 실리콘 결정을 키워 올리는 기술

안녕하세요? 반도체 마스터입니다.

오늘은 에피택시(Epitaxy) 성장을 다룹니다. 웨이퍼 표면에 원자를 한 층씩 쌓아 '결정'을 키우는 기술로, 특히 소스·드레인 영역에만 선택적으로 성장시키는 방식이 FinFET 시대의 핵심 공정입니다.

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에피택시란: 증착이 아닌 '성장'

에피택시는 그리스어로 '위에(epi) 배열하다(taxis)'라는 뜻으로, 기존 결정의 원자 배열을 그대로 이어받으며 층을 쌓는 방식입니다. CVD·PVD 증착이 덮는 막이라면, 에피택시는 밑바탕 결정의 격자 구조를 그대로 복제해 올린 단결정 층입니다. 결함 없는 단결정이라는 점이 핵심인데, 결정 결함은 전류 누설과 특성 산포의 원인이 되기 때문입니다. 증착막이 아무 데나 쌓이는 것과 달리 에피택시는 마스크로 가린 부분에는 자라지 않고, 노출된 실리콘 창에서만 성장합니다. 그래서 '선택적(Selective)' 에피택시라고 부릅니다. 선택성이 확보되는 이유는 마스크(산화막·질화막) 위에서는 원자가 핵생성을 시작하지 못하고, 노출된 실리콘에서는 기존 결정 격자를 씨앗 삼아 바로 성장하기 때문입니다.

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왜 FinFET 시대의 핵심이 되었나: SiGe 스트레인

트랜지스터가 미세화될수록 소자의 물리적 한계가 드러납니다. 채널 길이가 짧아지면 누설 전류가 커지고, 단순히 전압을 낮추는 것만으로는 성능을 지킬 수 없습니다. 여기서 등장한 것이 '스트레인(Strain) 엔지니어링'입니다. PMOS의 소스·드레인에 실리콘(Si) 대신 실리콘-저마늄(SiGe)을 에피택시로 키우면, 저마늄 원자가 실리콘보다 크기 때문에 채널을 양쪽에서 눌러 '압축 스트레인'을 가합니다. 압축을 받은 채널에서는 홀(Hole)의 이동도가 크게 오르고, 결과적으로 같은 전압에서도 더 많은 전류가 흐릅니다. 즉, 회로 설계 변경 없이 소자 속도만 끌어올리는 셈입니다. NMOS에는 반대로 탄소(C)를 소량 섞은 실리콘으로 '인장 스트레인'을 주기도 합니다. 면접에서는 "왜 SiGe인가"를 단번에 답할 수 있어야 합니다. 답은 저마늄 원자의 큰 격자 상수가 채널에 압축 변형을 만든다는 점입니다.

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대표 공정 조건과 관리 포인트

선택적 에피택시는 보통 수백 °C대의 고온에서 SiH₄나 SiH₂Cl₂ 같은 가스를 사용해 성장합니다. 성장 속도는 온도·가스 분압에 민감하고, 불순물(예: 보론) 도핑을 성장과 동시에 넣어주면 저항이 낮은 소스·드레인을 한 번에 만들 수 있습니다. 관리 포인트는 '결정성'입니다. 성장 온도가 낮거나 전처리 세정이 부족하면 마스크 위에도 비결정 막이 낄 수 있고(선택성 상실), SiGe의 저마늄 함량이 너무 높으면 격자 불일치로 전위(Dislocation) 결함이 생깁니다. 결함은 트랜지스터의 오프 전류 누설로 직결되므로, 에피택시 성장 후에는 결정 결함 밀도를 꼼꼼히 모니터링합니다.

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면접에서 묻는 포인트 정리

• 에피택시와 증착의 차이: 밑바탕 결정 격자를 이어받아 자라는 단결정 '성장' vs 그냥 쌓는 막
• 선택적 에피택시가 가능한 이유: 마스크 위에는 핵생성이 안 되고 노출 실리콘에서만 성장
• PMOS에 SiGe를 쓰는 이유: 큰 저마늄 원자가 채널에 압축 스트레인을 줘 홀 이동도 향상
• 저마늄 함량을 무작정 높이면 안 되는 이유: 격자 불일치 → 전위 결함 → 누설 전류

오늘은 에피택시 성장의 원리와 스트레인 엔지니어링을 정리해봤습니다. '결정을 키운다'는 표현의 의미를 이해하면 오래 기억에 남습니다!

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